[회로이론] 가산증폭기

등록일 2003.06.18 MS 파워포인트 (ppt) | 11페이지 | 가격 1,000원

목차

개 요
이상적인 연산증폭기
반전증폭기
비반전증폭기
두개의 입력단자를 갖는 가산기
n 개의 입력을 갖는 가산기
이득이 1보다 큰 가산기
스케일링 가산기
가상접지란

본문내용

개 요
이상적인 연산증폭기
반전증폭기 및 비반전증폭기
두개의 입력단자를 갖는 가산기
n 개의 입력을 갖는 가산기
이득이 1보다 큰 가산기
스케일링 가산기
가산증폭기 회로 Pspice 값
이상적인 연산증폭기
다음 조건을 만족하는 연산증폭기를 이상적인 연산증폭기라고 부른다.
 (1) 무한대의 전압이득 : Av = ∞
 (2) 무한대의 입력저항 : Rin = ∞
 (3) 영 옴인 출력저항 : Rout = ∞
 (4) 무한대의 대역폭 : B = ∞
 (5) 영인 오프셑 전압과 전류
 (6) 온도에 따른 소자 파라미터 변동이 없어야 한다.

반전증폭기
연산증폭기가 이상적인 증폭기이면, 신호전압의 형태나 주파수에 무관하게 식 (1)이 성립된다.
즉 증폭도는 단순히 두 개이 저항비만에 의해서 결정된다. 식 (1)의 앞에 나타난 음의 부호는
신호전압 Vs 와 출력전압 Vo 간의 위상차가 180°임을 가리킨다. 즉 반전되었음을 나타낸다.
비반전증폭기
연산증폭기의 입력저항이 무한대이기에 신호원에서 회로쪽으로 흐르는 전류 I = 0 이다. 가상
접지에 의하여 Vs = n 가 된다. 그리고 n 점에서 연산증폭기의 (-)입력단자측을 들여 다 본 저
항은 무한대이다. 따라서 전압 이득식은 다음처럼 주어진다
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