[컴퓨터구조] 컴퓨터구조

*영*

최초 등록일: 2003.05.14
최종 저작일: 2003.05; 38페이지/ MS 파워포인트; 가격 1,000원

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Recap: A Single Cycle Datapath
Rs, Rt, Rd and Imed16 hardwired into datapath from Fetch Unit
We have everything except control signals (underline)
Today…s lecture will show you how to generate the control signals
Recap: Meaning of the Control Signals
nPC_MUX_sel: 0 꽦 PC <좻 PC + 4 1 꽦 PC <좻 PC + 4 + SignExt(Im16) || 00
Later in lecture: higher-level connection between mux and branch cond
Recap: Meaning of the Control Signals
ExtOp: ¨zero〃, ¨sign〃
ALUsrc: 0 꽦 regB; 1 꽦 immed
ALUctr: ¨add〃, ¨sub〃, ¨or〃

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