실험 4. 멀티플렉서와 디멀티플렉서 예비보고서

*윤*

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최초 등록일: 2011.01.11
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멀티플렉서와 디멀티플렉서 결과보고서

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4. 멀티플렉서와 디멀티플렉서
예비보고서
(1) 다음 회로도의 AND gate, OR gate와 Inverter를 결선하여 2x1 Mux를 설계해 보시오.
※ 도움말 : AND 게이트와 OR 게이트의 bit mask 기능은 다음과 같다.
A AND 1 = A(pass 기능)
A AND 0 = 0(clear 기능)
A OR 0 = A(pass 기능)
A OR 1 = 1(set 기능)
이 성질을 이용하여 bit를 선택(switch or select)할 수 있다. 즉, 2개의 AND 게이트는 선택 입력인 S를 이용해 D0와 D1 중 어떤 것을 통과시키고(pass) 차단할(clear) 것인가를 결정할 수 있다.
< 회로도 >
멀티플렉서는 N개의 입력 데이터에서 1개씩 선택해서 단일 채널로 송신하는 기능을 가진 논리회로이다. 데이터의 선택은 선택입력에 의해서 제어된다. 논리식을 보게 되면 이 되고, 진리표는 다음과 같다.

(중략)

Enable 단자 ,이 1의 값을 가질 경우는 출력은 반드시 1이 된다. Enable단자 ,가 0일 경우 각각의 디코더 입력인 ,과 ,에 따라 각각 디코더 4개의 출력중 하나씩만 동작하게 된다.

참고 자료

1. http://princess.kongju.ac.kr/digitalmain/dvlec/textbook/chap04/digital04_1.htm
2. http://junyy.tistory.com/archive/200810 (중간부분)
3. 각 디코더의 data sheet

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